SDRAM突发读写注意

序言 最近的项目需要在设计一个SDRAM控制器，用于存储一段采样数据，然后等待上位机下发指令，把数据上报。采用连续突发读写模式BL为4，时钟50MHz。 SDRAM器件型号为MT48LC16M16A2。（4M*16*4banks），从上面的信息我们可以了解到，该SDRAM的数据总线为16bit,行地址有13根（8K），列地址为9根，有4个BANK。   问题现象          项目中的SDRA

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