Altera FPGA 差分信号初识(3)

时间 2020-02-04

标签 altera fpga 差分信号繁體版

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Altera FPGA 差分信号初识(3) 有了以前的了解，就能够开始试试用FPGA产生差分波形了。此次需求是mini-LVDS，先拿手头的锆石A4开发板试试。手头的锆石A4开发板预留有大量的IO口，这些IO的VCCIO 电平是 3.3V 的。FPGA右侧BANK预留的IO口有不少差分的IO(p&n)能够配置。html Quartus II Part 在苍月表明个人博客中有看到按照Quartu

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