Verilog学习（二）Verilog模型
主要有五种模型： 1) 系统级(system) 2) 算法级(algorithmic) 3) RTL级(RegisterTransferLevel): 4) 门级(gate-level): 5) 开关级(switch-level) 其中门类型有： 用户定义的原语（UDP） 注意点： 1) UDP只能有一个输出端，而且必定是端口说明列表的第一项。 2) UDP可以有多个输入端，最多允许有10个输入端
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