时序约束——相关基础概念
时序路径 典型的时序路径有4类： 建立保持时间 典型的时序模型如下图所示，一个完整的时序路径包括源时钟路径、数据路径和目的时钟路径，也可以表示为触发器+组合逻辑+触发器的模型。 Tclk ≥ Tco + Tlogic + Trouting + Tsetup - Tskew 其中，Tco为发端寄存器时钟到输出时间；Tlogic为组合逻辑延迟；Trouting为两级寄存器之间的布线延迟；Tsetup为
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