利用python自动生成verilog模块例化模板

1、前言html 　　初入职场，一直忙着熟悉工做，就没什么时间更新博客。今天受“利奇马”的影响，只好宅在家中，写写技术文章。芯片设计规模日益庞大，编写脚本成了芯片开发人员必要的软技能。模块端口动不动就几十上百个，手动编写代码伤不起。实现verilog模块例化模板的自动生成也算是我自砸饭碗的第一步了O(∩_∩)O！python 2、代码设计正则表达式 　　要自动生成模块例化模板总共分三步：1 打开设

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