BD文件validata design时候报错：Bus Interface property FREQ_HZ does not match

时间 2021-01-19

标签 FPGA # vivado 繁體版

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进行BD文件validata design时候，报错： [BD 41-237] Bus Interface property FREQ_HZ does not match between /DMA_AXIS_MM2S(100000000) and /axi_dma_0/M_AXIS_MM2S(200000000) 如图所示，自己定义了一个扩展接口DMA_AXIS_MM2S，该扩展接口默认的频率是1

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1. BD文件validata design时候报错：Bus Interface property FREQ_HZ does not match
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