FPGA——zhixin培训 Day_08——边沿检测
一、设计背景： 边沿检测电路：如上图，为我们待检测信号，可以看出边沿的特性：边沿两侧信号的电平发生了变化。红色为上升沿，绿色为下降沿。上升沿之前电平为低，上升沿之后电平为高。下降沿之前为电平为高，下降沿之后电平为低。 二、设计需求： 设计边沿检测电路，可检测上升沿和下降沿。 三、设计方案： 实序图： 五、代码 module check_edge(clk,rst_n,signal,pos_edge,
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