Verilog HDL语法学习1
一.模块 module xxx(输入、输出) 输入/输出端口定义...... 信号类型声明...... 逻辑功能定义...... endmodule 其中逻辑功能定义： 二. 数据类型和运算 1.常量类型 一种为连线型，另一种为寄存器型 ①，整数 ②，实数 ③，参数型 3.变量类型 ①.连线型 ②，寄存器型 ③，momery型 4.运算符 和c语言类似的不做说
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