阿扣的Verilog HDL 学习笔记⑤
第5章 门级建模 用表示门的术语描述电路（eg. and、nand…）。 门级原语；实例引用、门的符号、各类门的真值表；根据电路逻辑图生成Verilog描述；讲述上升、下降和关断延迟；最小、最大和典型延迟。 5.1门的类型 门级原语实例引用时不用指定实例名字 门的类型：类似于预定义的（无需声明）的模块。分为：与或门类(and/or)；缓冲器非门类(buf/not) 与门（and）&或门（or）：单
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