FPGA时序逻辑中常见的几类延时与时间（五）

    FPGA逻辑代码重要的是理解其中的时序逻辑，延时与各类时间的记忆也是一件头疼的事，这里把我最近看到的比较简单的几类总结起来，共同窗习。

   1、平均传输延时

平均传输延时

2、开启时间与关闭时间

开启时间与关闭时间

三极管Td 延迟时间   Tr上升时间   合称开启时间

三极管Ts存储时间    Tf降低时间    合称关闭时间

 3、触发器创建时间与保持时间

创建时间（Tsu：set up time）是指在时钟沿到来以前数据从不稳定到稳定所需的时间，若是创建的时间不知足要求那么数据将不能在这个时钟上升沿被稳定的打入触发器；保持时间（Th：hold time）是指时钟信号到来以后数据稳定保持的时间，若是保持时间不知足要求那么数据一样也不能被稳定的打入触发器。

4、锁存器  恢复时间和移除时间

      

在时钟沿到来以前的 recovery time 以前，异步信号必须释放 (变无效)，在时钟沿到来以后的 removal time 以后，异步信号才能变有效，也就是说在从 recovery time 到 removal time 这段时间内，异步信号是不能有效的。异步信号中的recovery time和removal time相似setup 和 hold time，能够考虑为异步复位信号。

输出响应时间（Tco）　：触发器输出的响应时间，也就是触发器的输出在clk时钟上升沿到来以后多长的时间内发生变化，也即触发器的输出延时。

5、Tc与Tm

Tc: time from clock to Q

                                                                                                                                                        Tm: Metastability Time