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基于vivado2017.4的 pynq-z2 overlay设计流程
时间 2021-01-11
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FPGA学习
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1、创建工程 2、创建block design 3、添加自定义ip的路径,以便在block design中调用 4、在block design中添加各个ip(vivado自带) 5、配置GPIO,并自动连线,优化路径 6、添加自定义ip,并连线 7、生成HDL wrapper、综合、生成bit流 8、生成.tcl文件 9、将此路径下的.bit文件复制出来,并重命名,与.tcl名字要一致 10、登陆
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