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基于vivado2017.4的 pynq-z2 PL端设计流程
时间 2021-01-11
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FPGA学习
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1、创建工程 “+”用于添加已编写完的源文件(.v文件) 若有已编写好的约束文件的化,则直接添加.xdc的约束文件 选择开发板型号 直接Finish 2、创建编写.v文件(design source) 创建设计文件 敲代码 3、仿真 仿真设置,主要设置仿真时间,相当于“#1000 $stop”语句;黄色框也可以选择其他仿真器(如:modelsim等等)以及仿真语言 创建仿真文件,同design s
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