21.FPGA之PLL锁相环使用
1.添加ip核异步 tools-megaWizardide 工程规范，存放在ipcore文件夹下post 设置参数：设计 a,速度等级3d 如下三行分别表明：code 是否添加异步复位component 是否添加locked信号，当locked从低电平到高电平时表示锁相环稳定blog 是否在时钟自锁的时候自动复位ip 配置第一路输出时钟资源 频率，相位，占空比 qip是quartus I
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