verilog之十人表决器

时间 2020-01-21

标签 verilog 之十表决繁體版

原文原文链接

功能描述：这是一个十个裁判表决的电路，基本功能：每一个裁判输入1：赞成；0：不一样意.code 按照少数服从多数的原则，输出状况除了经过、不经过或待定等状态。input module first(a1,a2,a3,a4,a5,a6,a7,a8,a9,a10,out); input a1,a2,a3,a4,a5,a6,a7,a8,a9,a10; //十路信号 output re

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