从零开始系类——CPLD和Verilog HDL
分享一本讲解关于CPLD与硬件描述语言Verilog的PDF书籍，笔者在这方面研究甚少，有时候也会搞不清楚CPLD与FPGA的区别，网上找了些不错的文章，汇总压缩解释如下： CPLD进行一次下载编程（写入操作）后，其内部逻辑门组合方式就保存下来，不管下次通电断电，依旧可以执行上一次逻辑操作。 不一样的是FPGA不能保存上次逻辑功能，断电后，FPGA就失去所有配置。因此FPGA通常需要带一块配置芯片
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