EP3C40的时钟管脚分类和锁相环(PLL)
我们还可以在图中看到GCLK，这个就是全局时钟数，它的概念很重要，全局时钟数就是一个网络，它能为FPGA内部的所有资源提供时钟信号，为什么要它来运作时钟信号呢？一句话，它能保证到达各种资源的时钟沿同步，skew非常小。 上图中我们还可以看出，EP3C40包含了四个锁相环(PLL),锁相环支持单端的时钟输入和差分的时钟输入两种输入方式，值得注意的是，只有使用专用的时钟输入管脚的时钟信号才能驱动锁相环
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