ABOV(14) UART
USI0 异步数据接收 接收外部数据结构时，UART包括一个时钟和数据恢复装置。时钟恢复逻辑用于将内部产生的比特率时钟和从RXD0引脚引入的异步连续数据结构同步。 据恢复逻辑对引入进行采样和低通滤波，这样可以消除RXD0脚上的干扰 下面举例说明对一个引入结构的开始位进行采样的过程。采样率为波特率正常模式时16次。，双速模式（DBLS0=1）时8次，水平箭头表示的是由于异步采样引起的同步变化，注意多
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