po一些verilog的代码
与RAM进行读写的操作 下面是相关代码，先是定义了几个端口，ram的读写地址和写/读数据端口，输入的ram_rd_data是没用到的。 上面的代码实现了使能判断，记了个数。 下面的代码实现在前32个时钟周期内将写的数据output到RAM里面，后32个周期内将读写的地址output到RAM里，就是简单的累加运算。 输出的是 这里有一个问题： 这里没有read的代码，如何read？（不需要写？本身就
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