细数Quartus系列综合器对SystemVerilog支持上的5个槽点
Quartus II以及后来的Quartus Prime（截止本文写做时其最新版本是v16.1）是Altera公司为自家FPGA编写的集成开发环境，包括编译、综合工具。工具不错，但对SystemVerilog的支持实在槽点多多，下面仅列出本人遇到的5个无力吐槽的编译器大BUG：web 1.不支持在interface中声明interface的实例 示例代码：express interface tes
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