时序分析基础(3)----output_delay
output_delay 分析模型 output_delay 的时序分析模型如上图所示，可以看到再进行IO之间的时序分析时，其模型于前面介绍的input_delay时序分析的模型是十分类似的。只不过再output_delay的分析中，上游芯片换成了FPGA，其内部的时序参数在使用时序分析工具进行分析时是已知的。下游芯片和PCB走线延时的时序参数在时序分析工具中不确定，因此才有了对于FPGA的输出数
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