转载-----BUFG，IBUFG，BUFGP，IBUFGDS等含义以及使用

时间 2020-08-02

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目前，大型设计通常推荐使用同步时序电路。同步时序电路基于时钟触发沿设计，对时钟的周期、占空比、延时和抖动提出了更高的要求。为了知足同步时序设计的要求，通常在FPGA设计中采用全局时钟资源驱动设计的主时钟，以达到最低的时钟抖动和延迟。 FPGA 全局时钟资源通常使用全铜层工艺实现，并设计了专用时钟缓冲与驱动结构，从而使全局时钟到达芯片内部的全部可配置单元(CLB)、I/O单元(IOB)和选择性块RA

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1. verilog-ise中BUFG和IBUFG的使用
2. Xilinx 7 series设计单元Buffer与IO——BUFG、IBUFG、IBUFDS_GTE2等
3. Xilinx FPGA中全局时钟资源的使用方法
4. Xilinx ISE中的DCM的使用
5. IBUFDS、IBUFGDS和OBUFDS
6. Xilinx FPGA全局时钟网络
7. FPGA时钟资源
8. Xilinx FPGA全局时钟和第二全局时钟资源的使用方法
9. Xilinx FPGA原语总结
10. DCM+BUFG的使用
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