FPGA进行多路并行插值滤波（多相滤波）的实现原理

　多相滤波器的基本概念是把FIR滤波器分割成若干较小的单元，然后组合这些单元的结果。首先，让我们考虑一个基于常规8抽头FIR滤波器的抽取子系统的符号表示，如图11所示(为了使用这些例子，我们假设抽取因子为M = 4 )。 　　 　　图11 基于传统的8抽头FIR滤波器的抽取器的符号表示 　　现在让我们假设主时钟正在以某一频率fHz运行。像往常一样，在滤波操作之后任何不要的样本将被丢弃，但这样做是低

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