Verilog练习一【奇数分频器】

时间 2020-08-08

标签 verilog 练习奇数分频器繁體版

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练习：实现50%占空比的5分频web //5分频，占空比为50% module clk_div_5(Clk_in, Rst_n, Clk_out); input Clk_in; input Rst_n; output Clk_out; reg [2:0] cnt, cnt1; reg clk_p, clk_n; parameter CNT_M = 3'd4,//N-1

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