Vivado时序分析工具使用 ----基准时钟、生成时钟、虚拟时钟

时间 2021-01-17

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前面的博客中，介绍了有关时序分析的基础，光说不练可不行,接下来的博客就对Vivado的时序分析工具操练一番。所使用的工程是一个以太网收发数据的工程。 1. 基准时钟约束基准时钟，也就是有FPGA外部输入到管脚从而进入FPGA内部的时钟。通常需要对这个时钟进行约束，编译器才能识别出其周期是多少。约束基准时钟，简单来说，就是为了让综合工具知道输入的驱动时钟的周期等信息。这里有一个已经综

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