异步电路中时钟同步的方法

时钟是数字电路中所有信号的参考，特别是在FPGA中，时钟是时序电路的动力，是血液，是核心。没有时钟或者时钟信号处理不得当，都会影响系统的性能甚至功能，所以在一般情况下，在同一个设计中使用同一个时钟源，当系统中有多个时钟时，需要根据不同情况选择不同的处理方法，将所有的时钟进行同步处理，下面分几种情况介绍时钟的同步处理方法。 第一种情况： 当有多个时钟在同一个数字电路中，且有一个时钟(Clk)的速率大

>>阅读原文<<