Zynq+zcu106学习随笔2-VCU硬件逻辑搭建
内容主要来自官方手册pg252-vcu。 vcu的逻辑电路还是还是很好理解，以下只记录觉得重要的部分。 1.添加Zynq UltraScale+ VCU IP以及Zynq UltraScale+ MPSoC到block design。 2.选择PL1 clock频率为333MHz,使能中断以及4个PS-PL从接口AXI HP。 3.剩下的连接如下图 值得注意
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