Verilog笔记

时间 2020-08-08

标签 verilog 笔记繁體版

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github传送门（练习写的代码，约束文件，仿真文件)html 文章目录 Vivado 基本流程关于封装IP核和使用Block Design Verilog module / 模块 always块组合逻辑时序 Generate块（书上p83） task / function 其余仿真 ip核的建立和使用方法：烧录 BASYS3 按键防抖方法数码管函数实现固定频率的方法：数码管数

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