X家FPGA开发流程（至简）
开发工具： Vivado2018.3 Verilog ZYNQ7z020 这是我做的完整流程，涉及到初级开发的功能； 1.新建工程：（RTL Project）芯片选型； 2.编写程序：源文件，仿真文件，约束文件(.xdc文件)； 3.时序仿真； 4.约束：IO配置有模板(.xdc文件)； 5.综合(synthesis)； 6.实现生成二进制文件（bitstream），下载验证。 创建工程部分就不具
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