【verilog】排序算法硬件实现（奇偶排序）

时间 2020-05-20

标签 verilog 排序算法硬件实现奇偶排序繁體版

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奇偶排序算法和求最大最小值基本知识网上有不少讲解，便再也不赘述因为verilog不支持输入端口为二维数组，本例直接把数据以随机数的形式放进寄存器RAM中，方便再里面做比较。且尽可能使用组合逻辑。web 代码：https://download.csdn.net/download/weixin_42183170/12082900算法仿真波形（看波形时从sort_inst中添加RAM1,RAM2进

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