AXI Stream 转AXI4 DMA IP设计

时间 2020-12-30

标签 verilog axi stream axi4 栏目 Apache 繁體版

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1.设计目的 axi stream接口无法直接通过axi4写内存，在项目使用中，经常遇到stream接口，例如srio、图像等，经过pcie传输，器件厂家虽然提供IP，但是使用不方便。 2.设计流程 2.1stream写 stream接口： tvalid：输入有效信号，高有效 tready：输出流控信号，高有效 tlast：输入数据尾信号，高有效 tkeep：输入数据字节使能信号，高有效 tuse

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7. AXI4、AXI-lite、AXI-Stream总线协议学习笔记
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