FPGA设计心得（4）Aurora IP core 的定制详情记录
文章目录 写在前面 IP核定制页面预览 IP核定制详解 lane width Line Rate GT REFCLK (MHz) INIT clk (MHz) DRP clk (MHz) Dataflow Mode Interface Flow control Back Channel GT selection 写在最后 同行邀请 参考资料 写在前面 很久没有在夜里写博客了，现在是凌晨3点多，写这
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