静态时序分析——Clocl Gating check

门控时钟是RTL级进行低功耗设计的最常用方法，能够有效降低动态功耗。在实际使用中，一般用ICG（集成门控时钟单元）来完成clock gating。ICG电路和时序如下： 通常来说，工艺库已经集成了ICG，在做门控时钟的时候其实不用考虑那么多。如果在实际设计中，工艺库未提供ICG，需要自己搭建一个门控时钟电路，那么在布局布线的时候可能要注意，不能将期间摆的太远，否则线延迟等会让这个结构失去其意义。

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