锁相环（PLL）的IP核调取及应用详解

时间 2021-07-10

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写在前面的话梦翼师兄经常告诉大家，FPGA最明显的优势就是它的速度。那么本节，梦翼师兄和大家一起来学习FPGA片内时钟管理单元PLL（锁相环）的应用。利用锁相环，我们可以在一个很宽广的范围内实现任意的分频和倍频。使用锁相环，可以有效的减少我们在时钟发生部分的代码量，同时更重要的，利用锁相环的“全局时钟树”，可以保证很好的时钟质量。项目需求我们使用锁相环生成两路时钟，一路为25MHz，另外一路

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