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quartusⅡ9.1波形仿真
时间 2020-12-27
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vhdl
quartus9.1 quartus FPGA VHDL HDL
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1.首先需要先编译成功 2.新建VMF文件 创建成功后如下: 3.添加输入端口和输出端口 双击虚线框 点击Node Finder 完成后: 点击两次OK后即可: 这时候可以选择输入端口进行输入波形的选择(左侧栏),例如时钟信号,全0或全1信号,随机信号等等。 4.进行仿真 选择process->simulator tool 成功观察波形即可。
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