低功耗之门控时钟设计

时间 2020-12-25

标签低功耗设计数字后端芯片时钟门控繁體版

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clock gating和power gating是降低芯片功耗的常用手段，相比power gating设计，clock gating的设计和实现更为简单，多在微架构、RTL coding阶段即可充分考虑，在综合时(compile_ultra -gate_clock)即可自动mapping到clock gating结构上去。本文先讲解clock gating，ICG的基本结构如下图所示：门控时钟

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1. 数字SOC设计之低功耗设计入门（一）——低功耗设计目的与功耗的类型
2. AT8563 低功耗时钟IC
3. HDL设计之低功耗设计
4. 数字SOC设计之低功耗设计入门（六）——门级电路低功耗设计优化
5. 数字SOC设计之低功耗设计入门（七）——门级电路低功耗设计优化（续）
6. 低功耗设计方法（3）—————RTL级低功耗设计
7. 数字SOC设计之低功耗设计入门（二）——功耗的分析
8. 数字SOC设计之低功耗设计入门（三）——系统与架构级低功耗设计
9. 数字SOC设计之低功耗设计入门（五）——RTL级低功耗设计（续）
10. 数字SOC设计之低功耗设计入门（四）——RTL级低功耗设计
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