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lvds在FPGA中的使用5 - ALTLVDS_TX核外部pll模式调试
时间 2021-01-06
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FPGA
lvds
低电压差分信号
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我的开发环境:quartus13.1 lvds连载4博文中,使用的是lvds核调用PLL的方式,这样一组lvds发送端口需要一个PLL,比较浪费资源。其实在使用ALTLVDS核时,还可以使用External PLL(外部pll),使用外部pll,不仅可以节省一个PLL,还可以减少逻辑资源的使用。 下面来说说调用ALTLVDS_TX核时,怎么使用外部PLL。与转载4相同,还是5个通道,每个通道对
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