Low Power Design Framework

时间 2020-02-12

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有人说基于65nm或更先进的工艺的设计，面积和频率再也不是瓶颈，反而功耗会成为新的瓶颈。框架不懂，若是设计时不注意，致使了更多的门、更高的频率，功耗怎么可以达到要求呢?dom 一个门不单单占用了硅片的面积，并且还带来了相应的功耗，所以更简化的设计一定带来更低的功耗。ui 能在低频率下完成的工做，为何必定要在高频率下完成呢？设计下面是前些天听的一个报告里提到的，关于低功耗设计的框架：ci E

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2. Low Power LSI Design (review) 2
3. bzoj3969 [WF2013]Low Power
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6. AG576 Low Power CPLD
7. low powder design
8. [CortexM0--stm32f0308]Low Power Mode
9. Euphrates: Algorithm-SoC Co-Design for Low-Power Mobile Continuous Vision
10. power design教程
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