FPGA学习：MODESIM与FPGA原理图联合仿真

时间 2020-12-31

标签仿真逻辑时序繁體版

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在QUARTUS中编译能够成功，Modelsim仿真时出现如下错误：“erro: Instantiation of '***' failed. The design unit was not found"。原因：在Modelsim中只能新建HDL类的文件，而不能采用原理图输入的方式，即Modelsim不能识别”原理图输入“方式。解决方法：首先，将原理图文件怎么变成HDL文件，FILE->New

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