uart异步串行收发器 设计报告
目录 1、设计需求 2、顶层设计 3、顶层架构 4、发送器线性序列机（线性链状态机）设计 5、接收器线性序列机设计web 1、设计需求缓存 1.一个具备接收发送流缓存的异步串行收发器 2.流缓存深度256，数据宽度8 3.异步串行收发器波特率9600 4.采用EIA建议，收发器时钟uart_clk为16倍波特率（16*9600=153.6K Hz） 5.UART编码：1个启始位，8个信息位，0个奇
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