QuartusII13.1 原理图编辑与仿真(半加器为例）
QuartusII13.1 原理图编辑与仿真 上次写了一个用Verilog语言完成的半加器，这次就用原理图的方法做一个吧。 还是先新建一个文件夹： 打开QuartusII，新建一个工程（也可以在file->new project wizard里新建）： 点击“Next” 选择我们刚才新建的文件夹并加上工程名称和项目名称： 点击“Next”，为文件取一个名字并添加进来： 选择目标器件 看自己需要选择
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