Vivado开发流程简介（FPGA）（硬件设计）

时间 2021-01-13

标签 Vivado FPGA Verilog 硬件设计 ISE 繁體版

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前言：系统环境windows7 +Vivado2016.1. 1、启动Vivado： 2、选择Create New Project： 3、指定工程名字和工程存放目录： 4、选择RTL Project： 5、选择FPGA设备： 6、工程创建完成后： 7、开始编写verilog代码：（1）点击Add Sources按钮：（2）选择add or create design sourc

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