FPGA信号序列监测工具

时间 2021-01-20

标签 # VSTAR fpga 序列监测软件繁體版

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VSTAR基本本节介绍使用 VSTAR 的设计流程和 VSTAR 的基本内容。下图1说明了使用 VSTAR 的设计流程的大纲。首先，FPGA项目是从FPGA项目数据导入的，RTL文件是使用设计窗口复制的。对于导入的FPGA项目，设置参数以生成VSTAR IP，并选择信号以探测和更新设计。之后，FPGA合成执行，然后FPGA设计数据（比特流）可以下载到FPGA。如果设置完成，则运行装有 VST

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