CLOCK_DEDICATED_ROUTE约束应用

时间 2021-01-21

标签 fpga 繁體版

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Vivado工具在编译时通常会自动识别设计中的时钟网络，并将其分配到专用的时钟布局布线资源中。通过对某些时钟网络设置CLOCK_DEDICATED_ROUTE值为FALSE，可以将被识别为时钟网络并按照时钟网络进行布局布线的时钟信号安排到通用的布线资源中。比如，某些时钟信号由于设计疏忽或其它原因，没有被安排到FPGA器件的时钟专用引脚上，在编译的时候就会报错，此时就可以使用CLOCK_DEDICA

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1. vivado CLOCK_DEDICATED_ROUTE约束的使用
2. 使用约束
3. oracle约束：主键约束，外键约束以及非空约束和惟一约束以及check约束
4. SQLServer中有五种约束，Primary Key约束、Foreign Key约束、Unique约束、Default约束和Check约束
5. oracle约束：主键约束，外键约束以及非空约束和唯一约束以及check约束
6. SQLServer 中有五种约束， Primary Key 约束、 Foreign Key 约束、 Unique 约束、 Default 约束和 Check 约束
7. 周期约束+IO约束
8. 移动应用的架构约束
9. 数据表的约束操作（主键约束、非空约束、唯一约束、外键约束）
10. 主键约束，主键约束并自增，唯一约束，非空约束，外键约束
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