#FPGA学习笔记# 如何实现３—８译码器
一、原理 1、简述：三位二进制信号的输入，实现八位二进制信号的输出 2、真值表如下 其中 A、B、C是三路输入，EN为使能端 二、实验代码 module My3_8(a,b,c,out);
input a;
input b;
input c;
output reg [7:0]out;
[email protected](a,b,c)
begin
case({a,b,c})
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