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谈谈Xilinx UltraScale的6输入LUTS(查找表)和SLICE(二)
时间 2020-12-25
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FPGA
MPSOC
Xilinx
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应用数学
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接着上一篇继续聊,Xilinx原来的LUT为4输入的,这个没有什么可说的,后来改成了6输入的。但是他是真的6输入吗? 仔细看看就会发现,他其实是两个5输入的结合。UltraScale 的UG里面只是有一些描述,但是我在Spartan6的UG里面发现了一张图。这不就是两个5输入加一个多路复选器吗,而且你要说他完全是2个5输入么又不完全是,因为他的A[5:1]是共用的。 所以Xilinx对于他的6输入
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