xilinx FPGA 固化代码流程

时间 2020-12-20

标签 vivado 繁體版

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Xilinx VIVADO固化流程纯verilog工程，不涉及SDK代码的固化流程：综合，实现，生成比特流后，点击Tools—Generate Memory Cinfiguration File… 如图，选择所用FLASH的类型，设置生成mcs文件名，选择生成的比特流文件，文件保存路径自动显示为如图。板子上电，连好JTAG，Open Target后，点击Add Configuration M

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