vivado static timing analysis
没有彻底弄清，记下一些疑惑以下：ui 0， setup与violation理解：spa T0 时刻，数据从D 1的C端入、Q端出、穿过logic到达D2的D端，到达时间记做T0'；此后数据在D2的D端保持稳定，直到下一时钟，即T1时刻到来； T1时刻后，来自D1的新数据通过C端入、Q端出、穿过logic到达D2的D端，到达时间记做T1'；从T1时刻到下一周期T2时刻到来，只会变化这一次； T0
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