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Vivado将模块封装为IP的方法(网表文件)
时间 2020-12-20
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FPGA Vivado 封装ip 网表
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在给别人用自己的工程时可以封装IP,Vivado用封装IP的工具,可以得到像xilinx的ip一样的可以配置参数的IP核,但是用其他工程调用后发现还是能看到源文件,如何将工程源文件加密,暂时没有找到方法,如果知道还请赐教。而直接用.edif网表文件作为ip的方法如下: 1、建立工程设置顶层模块 将需要封装的模块设置为顶层模块。(shift_bus模块) 2、综合待封装模块 vivado综合时会默认
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