基于Xilinx的RapidIO核配置和AXI-SRIO核设计

Rapid IO协议由于无主机，且各设备之间可以并行交换信息，所以广泛应用于对交换速率要求高，且交互复杂的应用中。 图0.1 SRIO应用场景 Xilinx现在有支持Serial RapidIO Gen2的核，可以应用在此场景中，但Xilinx 的 Rapid IO 核对外接口仅有 AXI 流接口 ，且对各类数据流的处理需要外部单独设计，不能方便的对消息、门铃、数据进行读写传输。本文介绍了将Rap

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