74160异步清零法解析(以接成三进制加法计数器为例)
我们先来看一下电路图, 从中提取核心信息: ①QB、QA通过一级与门后再通过一级非门接到CLR引脚. 3进制加法计数器共有3个有效状态0000、0001和0010, 而电路状态到达0011时, CLR引脚立即变为低电平, 电路状态清零, 即变为0000, 而后CLR引脚又恢复高电平, 计数器继续计数. 0011其实是一个过渡状态, 不算在有效状态之类. 故接成的电路实现了3进制加法
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